안녕하세요.
다른분들이 베릴로그로 코드를 짠것을 보다보면 #1, #2와 같은 지연을 문장내에 삽입하던데,
왜 이렇게 하는지 궁금합니다.
Ex1) wire [3:0] #1 b = ~b;
Ex2) assign #1 a = b;
첫댓글 게이트마다 지연시간이 존재하는데 functional simulation에서 임시로 흉내냅니다
실제회로에 조금더 가깝게 하기위함 아닐까요!!!
아하~~ 그렇군요 감사합니다.
첫댓글 게이트마다 지연시간이 존재하는데 functional simulation에서 임시로 흉내냅니다
실제회로에 조금더 가깝게 하기위함 아닐까요!!!
아하~~ 그렇군요 감사합니다.